PRODUCT/PROCESS CHANGE NOTICE (PCN)
发布时间：
2018-07-31
类型：
产品变更通知及停产信息，PCN通知、停产通告
品牌：
IDT（艾迪悌）
型号：
IDT7200; IDT72V01; IDT7201; IDT72V02; IDT7202; IDT72V05; IDT7205; IDT72V06; IDT7206; IDT72V81; IDT7280; IDT72V82; IDT7281; IDT72V85; IDT7282; IDT72V205; IDT7285; IDT72V215; IDT72205; IDT72V221; IDT72215; IDT72V225; IDT72221; IDT72V231; IDT72225; IDT72V235; IDT72231; IDT72V241; IDT72235; IDT72V245; IDT72241; IDT72V255; IDT72245; IDT72V261; IDT72255; IDT72V265; IDT72261; IDT72V271; IDT72265; IDT72V805; IDT72271; IDT72V815; IDT72805; IDT72V821; IDT72815; IDT72V825; IDT72821; IDT72V831; IDT72825; IDT72V835; IDT72831; IDT72V841; IDT72V845; IDT72841; IDT72845; IDT72835
本产品/工艺变更通知（PCN）详细阐述了Integrated Device Technology, Inc.（IDT）针对FIFO产品实施的晶圆制造工艺迁移方案。该资料明确指出，相关产品的生产地点已从FAB-2（加利福尼亚州萨利纳斯）转移至FAB-4（俄勒冈州希尔斯伯罗），变更生效日期为2002年6月1日。此次调整仅涉及制造产线的物理迁移，核心制造技术保持不变，且新增“4”字符以标识FAB-4材料。此外，该通知还包含了相关的资格数据，并修正了此前版本中的印刷错误，旨在确保用户对产品变更信息的准确掌握。针对文中所述IDT品牌器件，在世强硬创平台上由世强先进（深圳）科技股份有限公司授权代理并提供技术支持及采购服务。基于该资料，用户可通过平台获取原厂授权的正品器件，相关型号支持单件起订、在线下单、样品申请及批量询价，且库存充足。平台专职FAE团队将提供从选型、设计验证到调试的全流程技术支持，覆盖从研发打样到量产的全生命周期采购需求，有助于缩短供应链响应周期，加速产品开发与上市进程。
资料下载
资料平台
| 数据手册 - 英文 |
IDT72V01 3.3伏CMOS异步FIFO数据表
NOVEMBER 2017
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知（PCN）
REV. 00
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知（PCN）
REV. 00
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知（PCN）
REV. 00
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知（PCN）
REV. 00
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| 产品勘误说明 - 英文 |
勘误表通知
Rev. 00
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| 产品勘误说明 - 英文 |
勘误表通知
Rev. 01
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| 数据手册 - 英文 |
3.3伏CMOS异步FIFO数据表IDT72V01、IDT72V02、IDT72V03、IDT72V04、IDT72V05、IDT72V06
11/27/2017
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| 数据手册 - 英文 |
IDT7200L CMOS ASYNCHRONOUS FIFO
NOVEMBER 2017
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）A-0309-04
REV. 00
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| 数据手册 - 英文 |
IDT72V81 IDT72V82 IDT72V83 IDT72V84 IDT72V85 3.3伏CMOS双异步FIFO双512 x 9，双1024 x 9双2048 x 9，双4096 x 9双8192 x 9数据表
NOVEMBER 2017
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| 数据手册 - 英文 |
3.3伏CMOS双异步FIFO数据表IDT72V81 IDT72V82 IDT72V83 IDT72V84 IDT72V85
12/11/2017
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| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）F-07-01
Rev. 01
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| 数据手册 - 英文 |
CMOS异步FIFO数据表IDT7200L IDT7201LA IDT7202LA
11/27/2017
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| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）F-03-01
Rev. 01
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| 数据手册 - 英文 |
CMOS异步FIFO数据表IDT7203 IDT7204 IDT7205 IDT7206 IDT7207 IDT7208
11/27/2017
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| 产品变更通知及停产信息 - 英文 |
产品停产通知
May 15, 2003
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| 产品变更通知及停产信息 - 英文 |
产品停产通知
April 6, 2005
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| 数据手册 - 英文 |
IDT72V805 3.3 VOLT CMOS DUAL SyncFIFO™ DUAL 256 x 18, DUAL 512 x 18,DUAL 1,024 x 18, DUAL 2,048 x 18and DUAL 4,096 x 18
MARCH 2018
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）F0301-01
REV. 00
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IDT7203 CMOS ASYNCHRONOUS FIFO
NOVEMBER 2017
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| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）T-05-02
Rev. 00
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| 数据手册 - 英文 |
IDT72V801 3.3 VOLT DUAL CMOS SyncFIFO™ DUAL 256 X 9, DUAL 512 X 9,DUAL 1,024 X 9, DUAL 2,048 X 9 DUAL 4,096 X 9 , DUAL 8,192 X 9
MARCH 2018
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| 数据手册 - 英文 |
IDT72V801,IDT72V811,IDT72V821,IDT72V831,IDT72V841,IDT72V851 3.3 VOLT DUAL CMOS SyncFIFO™ DUAL 256 X 9, DUAL 512 X 9,DUAL 1,024 X 9, DUAL 2,048 X 9,DUAL 4,096 X 9 , DUAL 8,192 X 9
03/15/2018
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IDT72V801 IDT72V811 IDT72V821 IDT72V831 IDT72V841 IDT72V851 3.3 VOLT DUAL CMOS SyncFIFO™ DUAL 256 X 9, DUAL 512 X 9, DUAL 1, 024 X 9, DUAL 2, 048 X 9, DUAL 4, 096 X 9 , DUAL 8, 192 X 9
03/15/2018
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| 产品变更通知及停产信息 - 英文 |
F0301-01产品/工艺变更通知单
REV. 00
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3.3 VOLT DUAL CMOS SyncFIFO™ DUAL 256 X 9, DUAL 512 X 9, DUAL 1,024 X 9, DUAL 2,048 X 9, DUAL 4,096 X 9 , DUAL 8,192 X 9 IDT72V801 IDT72V811 IDT72V821 IDT72V831 IDT72V841 IDT72V851
NOVEMBER 2014
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| 产品变更通知及停产信息 - 英文 |
集成设备技术公司6024 Silver Creek Valley Road，San Jose，CA-95138产品/工艺变更通知（PCN）PCN#：A-0504-02R2
08/03/05
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IDT72V805 3.3 VOLT CMOS DUAL SyncFIFO
MARCH 2018
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知（PCN）A-0408-01版本1 PQFP包系列
REV. 00
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世强AI
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应用/方案
级联FIFO或FIFO模块技术说明
本资料介绍了IDT7200/7201/7202/7203/7204/7205/7206/7207/7208系列高速FIFO的级联配置方法。详细解释了级联FIFO的工作原理，包括写操作和读操作的脉冲信号传递，以及如何处理标志位。资料还讨论了如何利用布尔方程生成中间标志，并提供了相关电路图和案例分析。
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级联FIFO或FIFO模块技术说明
本文档详细介绍了IDT7200/7201/7202/7203/7204/7205/7206/7207/7208系列高速FIFO（先入先出）存储器的设计和级联配置。文章解释了如何通过级联这些FIFO来形成更深层次的存储器，并提供了级联FIFO配置的示例。此外，还讨论了读写操作中的时序脉冲、交叉干扰噪声的防止以及如何处理标志位。
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级联FIFO或FIFO模块技术说明TN-09
本文详细介绍了IDT7200/7201/7202/7203/7204/7205/7206/7207/7208系列高速FIFO的级联配置方法。文章解释了级联FIFO的工作原理，包括如何通过XO（扩展输出）和XI（扩展输入）线进行数据传输和指针控制。此外，文章还讨论了如何处理标志位，以及如何利用布尔方程生成中间标志位。最后，文章强调了设计注意事项，如避免串扰噪声和正确处理标志位。
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FIFOs设计技术说明
本文介绍了如何设计使用FIFO（First-In/First-Out，先进先出）缓冲器。主要内容包括FIFO的基本原理、IDT7201至IDT7204系列高速FIFO的特点、复位操作要求、读写指针操作、信号完整性问题以及设计时的注意事项。文章还提到了如何解决信号反射、阻抗不匹配等问题，并强调了良好的板级设计技巧和去耦电容的重要性。
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FIFOs设计技术说明
本文档为IDT公司发布的关于FIFO（先进先出缓冲器）设计的技术笔记。内容涵盖了IDT7201至IDT7204系列高速FIFO的设计要点，包括复位操作、读写指针、信号完整性、噪声抑制和电路设计建议。文档强调了正确设置读写使能信号、处理信号反射和串扰、以及使用去耦电容的重要性。
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【产品】单片高速、低功耗CMOS双向时钟FIFO存储器IDT72V3612，3.3V电源供电
瑞萨电子公司（Renesas）的全资子公司IDT推出的IDT72V3612采用3.3V电源供电，具有极低的功耗。 该器件是单片高速，低功耗CMOS双向时钟FIFO存储器。 它支持高达83 MHz的时钟频率，并且具有高达8ns的读取访问时间。 FIFO在IDT标准模式下运行。芯片缓冲区数据板上具有两个独立的64x36双端口SRAM。
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【产品】3.3V CMOS同步双FIFO存储器
IDT72V801/IDT72V811/IDT72V821/IDT72V831/IDT72V841/IDT72V851是同步双FIFO存储器。单一封装下功能分别相当于两个IDT72V201/IDT72V211/IDT72V221/IDT72V231/IDT72V241/IDT72V251，关联的控制线、数据线和状态标签线被分配到不同的管脚。
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零总线掉头（ZBT）SRAMS与延迟写SRAMS的应用比较
本文对比了零总线周转（ZBT）SRAM和晚写SRAM的性能差异。ZBT SRAM通过消除总线上的空闲周期，实现了100%的数据总线利用率，而晚写SRAM在读写交替时存在空闲周期，导致总线利用率降低。文章详细比较了两种SRAM的读写时序、时钟边沿使用和数据总线利用率等方面的差异。
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用FIFOs技术说明TN-06设计
本文档为IDT公司发布的关于FIFO（先进先出缓冲器）设计的专业技术笔记。内容涉及IDT7201至IDT7204系列高速FIFO的特性和设计注意事项，包括复位操作、读/写指针、噪声抑制、信号完整性以及电路设计建议。文档强调了正确设置读/写使能信号、处理信号反射和串扰的重要性，并提供了优化设计的方法。
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满边界和空边界条件下的FIFO操作技术说明TN-08
本技术笔记主要讨论了IDT7201至IDT7204系列FIFO（先进先出存储器）在满和空边界条件下的操作。内容涵盖了FIFO的控制线、读写指针、空满标志以及边界条件下的特殊时序问题。特别强调了在FIFO满时继续写入和空时继续读取时，可能出现的时序违规及其影响，并提出了相应的解决方法。
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满边界和空边界条件下FIFO的操作技术说明
本技术笔记主要讨论了IDT7201至IDT7204系列FIFO（先进先出存储器）在满和空边界条件下的操作。这些FIFO具有四个控制线：读、写、复位和重传。笔记重点介绍了读（R）和写（W）线与FIFO空和满状态的关系。FIFO在满状态继续写入和读操作时，以及空状态继续读和写操作时，存在特殊条件。读和写操作在各自的时钟上升沿增加读和写指针，这些指针影响空标志和满标志计数器。笔记还讨论了违反时序规范可能导致的问题，以及如何通过主复位来恢复。
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全、空边界条件下FIFOs运算技术说明
本技术笔记主要讨论了IDT7201至IDT7204系列FIFO（先进先出存储器）在满和空边界条件下的操作。详细分析了读（R）和写（W）控制线与FIFO空和满状态的关系，以及如何处理异步和同步读写操作。特别强调了在FIFO满时继续写入和读取操作，以及空FIFO继续读取和写入操作时的特殊时序和条件。此外，还讨论了违反时序可能导致的问题，如指针失步和数据损坏，以及如何通过主复位来恢复。
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RC32332局域网（LAN）交换机应用简介
本文介绍了局域网交换机在计算机网络中的重要性，特别是在网络速度和带宽增加的背景下。文章讨论了网络管理员面临的挑战，如用户效率统计、服务质量（QoS）和网络流量管理。针对这些挑战，文章介绍了IDT的RC32332通信处理器和BCM95615S局域网交换机参考设计，这些设计旨在提供低成本、易于管理的网络解决方案，以优化网络资源的使用并支持高带宽、低延迟的应用。文章还强调了轻量级管理交换机在桌面本地网络中的应用，以及它们如何与高性能交换机 fabrics和软件平台相结合，以实现更智能的网络管理。
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RC32351客户场所设备（CPE）集成通信处理器应用简介
本文介绍了IDT公司针对家庭用户设备（CPE）的集成通信处理器解决方案。该方案旨在满足服务提供商降低系统成本的需求，同时支持多种I/O接口，包括有线和无线。文章详细介绍了IDT的RC32351/RC32355集成通信处理器，其特点包括高性能、低功耗、小尺寸和高可配置性。此外，文章还介绍了IDT提供的参考设计平台和软件解决方案，以加速CPE市场的产品开发。
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IDT的RC32355集成通信处理器解决方案
IDT的RC32355集成通信处理器是一款针对客户设备（CPE）的完整解决方案。该处理器结合了IDT的32位RISCore™ 32300 CPU核心、IPBus系统级集成设计方法以及一系列通用和通信专用外围设备。它支持多种通信接口，包括以太网、ATM、USB和TDM，适用于从简单DSL调制解调器到高端住宅网关等多种CPE设备。IDT还提供了基于RC32355的硬件参考设计和软件解决方案，以加快系统开发周期并缩短产品上市时间。
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读端口操作3.3V多队列流量控制装置应用说明
本文介绍了多队列流控制设备的数据读取操作，主要涉及读取设备如何处理从多队列流控制设备读取的数据。文章详细讨论了四种可能的读取事件，包括从已选队列读取、首次字通过（FWFT）模式、队列切换时的读取操作以及新队列首次字通过。文章还提供了在读取设备控制逻辑中实现的整体解决方案，包括硬件实现示例。
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读端口操作3.3V多队列流量控制装置应用说明
本文档详细介绍了多队列流控制设备（如IDT72V51233系列）的读取端口操作。内容涵盖四种可能的读取事件：1. 从先前选择的队列读取；2. 队列“首次字通过”（FWFT）模式；3. 队列切换时的最终读取；4. 队列切换时的首次读取。文档还提供了处理这些事件的阅读设备控制逻辑示例，包括FPGA的Verilog代码。
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读3.3V多队列流量控制设备应用说明AN-338的端口操作
本文介绍了多队列流控制设备的数据读取操作，主要针对IDT72V系列设备。内容包括四种可能的读取事件：1. 从已选队列读取；2. 队列“首次字通过”模式；3. 队列切换时的读取；4. 队列切换时的首次字读取。文章详细分析了每种事件的处理方法，并提供了FPGA Verilog代码示例，用于检测和读取有效数据字。
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通过Stewart Speed APPLICATION NOTE AN-349将IDT的3.3V多队列流控制设备连接到VIRTEX II FPGA
本文档详细介绍了如何将IDT的3.3V多队列流控制设备与Virtex II FPGA进行接口连接。文档涵盖了设备的基本概念、架构、队列配置、标志操作、总线宽度匹配、深度/队列扩展等方面。此外，还提供了设置、配置和基本操作指南，包括主复位、编程、正常操作、包模式操作等。文档还提供了Verilog代码示例，以帮助用户理解和实现设备控制逻辑。
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接口IDT的3.3V多队列流量控制设备到VIRTEX II FPGA应用说明
本文档详细介绍了如何将IDT的3.3V多队列流控制设备与Virtex II FPGA进行接口连接。文档涵盖了设备的基本概念、架构、配置、操作模式以及与Virtex II FPGA的接口连接。重点包括队列配置、标志总线操作、数据写入和读取控制、以及如何进行设备编程和配置。此外，文档还提供了Verilog代码示例，以帮助用户理解和实现与IDT多队列流控制设备的交互。
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