EEPROM PROGRAMMABLE 2.5V PROGRAMMABLE SKEW PLLCLOCK DRIVER IDT5T9890
发布时间：
2018-08-01
类型：
数据手册，规格书、Datasheet；PDF下载
品牌：
IDT（艾迪悌）
型号：
IDT5T9890; 5T9890NLGI
本数据手册详细介绍了IDT5T9890，这是一款2.5V EEPROM可编程偏斜PLL时钟驱动器，专为高性能计算和数据通信应用设计。该器件具备5对可编程偏斜输出，能够输出领先或滞后于REF输入信号的时钟，支持4.17MHz至250MHz的输入频率及12.5MHz至250MHz的输出频率。其关键特性包括低抖动性能（周期到周期小于75ps）、低偏斜设计，以及兼容展频输入时钟。IDT5T9890内部集成了非易失性EEPROM，支持通过JTAG或I2C总线进行串行接口编程，并可选正或负边沿同步、同步输出使能及关断模式。在接口方面，该器件支持HSTL、eHSTL、1.8V/2.5V LVTTL或LVEPECL等多种输入输出接口标准，具备热插拔和耐压输入功能，并提供外部差分反馈与内部环路滤波器，适用于PCB迹线延迟补偿、后平面传播延迟调整及特殊时钟组件间的时序关系处理，采用VFQFPN封装。
针对文中所述器件，IDT在世强硬创平台上由世强先进（深圳）科技股份有限公司授权代理并提供技术支持及采购服务。基于该方案，用户可通过平台获取原厂授权的正品器件，相关型号支持单件起订、在线下单、样品申请及批量询价，且库存充足。平台专职FAE团队可提供从选型、设计验证到调试的全流程技术支持，覆盖从研发打样到量产的全生命周期采购需求，有助于缩短供应链响应周期，加速产品开发与上市。
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加工定制
整体外形尺寸小至0.6*0.3*0.3mm (DFN0603)，工作电压范围覆盖2.5V~36V，电容值低至0.2pF，浪涌能力最高可达240安培，静电等级可达空气放电、接触放电±30KV。提供免费浪涌测试仪、静电测试仪测试。
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资料平台
| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）U-10-19
Rev.02
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| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）U-10-19R1
Rev.02
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）A-0511-01
REV. 00
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信号完整性与时钟系统设计
2020/01/17
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| 产品变更通知及停产信息 - 英文 |
A-0603-02 IDT5T2010NLGI产品/工艺变更通知单
21-Mar-2006
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| 产品变更通知及停产信息 - 英文 |
产品停产通知（PDN）U-10-21R2
Rev.02
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产品停产通知（PDN）U-10-21R1
Rev.02
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）PCN#：A1311-03R1
17-Feb-2014
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）PCN#：A1311-03
4-Dec-2013
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| 产品变更通知及停产信息 - 英文 |
IDT10206-PL84-ASM产品/工艺变更通知（PCN）
21-Mar-2006
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| 产品变更通知及停产信息 - 英文 |
产品/工艺变更通知单（PCN）TB-0609-03
REV. 00
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| 产品变更通知及停产信息 - 英文 |
ICS1892Y-10产品/工艺变更通知单（PCN）
11-Jan-2007
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| 技术文档 - 英文 |
EEPROM可编程2.5V可编程斜交PLL差分时钟驱动器
NOVEMBER 2004
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| 数据手册 - 英文 |
EEPROM可编程2.5V可编程斜交PLL差分时钟驱动器
2004-11-01
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| 数据手册 - 英文 |
DAC1008D650双通道10位DAC；最高650 MSPS；通过JESD204A接口实现2倍、4倍或8倍插值
Rev. 04
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81006i VCXO-to-6 LVCMOS输出
REVISION B
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ICS85214I低偏斜、1至5、差分至HSTL扇出缓冲器
REVISION B
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IDT54/74FCT273T/AT/CT快速CMOS八通道D触发器，具有主复位功能
JUNE 2002
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IDT54/74FCT299T/AT/CT快速CMOS 8输入通用移位寄存器
6/24/2002
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IDT54/74FCT646T/AT/CT快速CMOS八通道收发器/寄存器（3态）
JUNE 2002
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IDT54/74FCT541T/AT/CT快速CMOS八通道缓冲器/线路驱动器
JUNE 2002
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IDT72V73250 3.3 VOLT TIME SLOT INTERCHANGE DIGITAL SWITCH
12/04/2012
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| 数据手册 - 英文 |
IDT74LVC16374A 3.3V CMOS 16-BITEDGE-TRIGGERED D-TYPEFLIP-FLOP WITH 3-STATE OUTPUTS,5 VOLT TOLERANT I/O
AUGUST 2015
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| 数据手册 - 英文 |
IDTQS3861 QUICKSWITCH® PRODUCTSHIGH-SPEED CMOS 10-BITBUS SWITCH WITHFLOW-THROUGH PINOUT
JANUARY 2013
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| 数据手册 - 英文 |
844N255I FemtoClock® NG Crystal-to-LVDS Clock Synthesizer
April 28, 2016
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| 技术文档 - 英文 |
ATM的逆复用IDT82V2604
Version - 4
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| 数据手册 - 英文 |
IDT7203 CMOS ASYNCHRONOUS FIFO
NOVEMBER 2017
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IDT8V41N004I FemtoClock® NG Crystal-to-HCSL Clock Generator
REVISION A
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IDT74LVCH16601A 3.3V CMOS 18-BIT UNIVERSAL BUS TRANSCEIVER WITH 3-STATE OUTPUTS,5 VOLT TOLERANT I/O, BUS-HOLD
JUNE 2006
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IDT74FCT162823AT/CT快速CMOS 18位寄存器数据表
SEPTEMBER 2009
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9FGL6241/9FGL6251 nVME智能PCIe时钟缓冲/发生器产品介绍
November 9, 2018
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技术论坛
ZSC31015KlT套餐包含些什么？有上位机软件吗？
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是否可以在不影响EEPROM内容的情况下对可编程时钟5T982x/5T989x进行重新编程？
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一旦IDT P9030在线圈上检测到有效接收器，其他无线电源线圈（多线圈配置）是否会被禁用（停止ping）？
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目前市面上除了小米本身，是否有其他支持小米9 Pro 30W无线充方案?
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如何将一个标准的输出缓冲区连接到另一个标准的输入缓冲区？
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IDT 82V3255 T0 DPLL的操作和转换状态是什么？
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IDT82V2081如何接收和发送2048kHz时钟
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如何为IDT定时器件接口3.3V LVDS至2.5V LVDS
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IDT温湿度传感器的优势在哪里
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应用/方案
系统应用和设计指南与IDT的零延迟缓冲器应用说明
本应用报告介绍了使用IDT零延迟缓冲器实现输入参考时钟与输出时钟之间定义的相位关系的方法。报告重点讨论了在PLL反馈回路中变化的迹线长度和反馈时钟输入处的电容负载对产生提前（或延迟）时钟的影响。提前时钟是指输出时钟的相位相对于参考输入时钟提前的情况。报告还涉及了PLL的工作原理、零延迟缓冲器的定义以及如何调整零延迟缓冲器的相位误差。
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可编程时钟应用注释AN-234
本文档为IDT5T989x和IDT5T982x系列可编程时钟器件的应用指南。文档详细介绍了器件的功能、特性、编程方法和使用注意事项。主要内容包括：
1. 器件概述：介绍器件的家族成员、功能特点、应用领域等。
2. 特性描述：详细说明器件的输出使能、PLL旁路、上电条件、JTAG/I2C串行配置、可编程偏移、频率倍增/分频、输入/输出I/O标准等特性。
3. 使用可编程时钟软件和编程套件：介绍软件的功能、使用方法、编程步骤等。
4. 系统内编程：介绍JTAG和I2C接口的编程方法。
5. 编程示例：提供编程实例，帮助用户理解编程过程。
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锁相环锁定指示灯
本文介绍了PLL锁相检测器的原理和应用。主要内容包括PLL锁相检测器的实现、工作流程、相位差值计算以及锁相和失锁状态的定义。此外，还讨论了相位抖动对锁相检测器的影响，并提供了避免因相位抖动导致的误失锁指示的建议。文章还涉及了实验设置和测试结果，以及如何使用 glitch 滤波器来处理锁相信号。
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82V3910 WANPLL–应用程序员接口参考手册
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8V9705x评估板用户指南
本指南介绍了IDT 8V9705x评估板的使用，该板用于评估8V97051、8V97051L、8V97053和8V97053L IDT宽带射频合成器。通过USB连接PC和IDT Timing Commander软件，用户可以配置和编程设备以生成具有最佳性能的频率。指南涵盖了硬件连接、软件配置和默认启动条件。
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文档控制门户用户学习指南
本指南旨在为IDT文档控制门户的用户提供操作指南，涵盖文档控制门户的设置、文档操作、版本控制、工作流程、搜索功能以及管理技巧。指南详细介绍了文档库的结构、文件命名规范、上传和编辑文档的方法，以及如何设置版本控制和工作流程。此外，还包括如何使用搜索功能、管理权限和设置元数据导航等内容。
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设计提示：IDT PCIe®Gen2交换机中的时钟体系结构
本文介绍了IDT PCIe Gen2交换机的时钟架构。内容包括全球参考时钟输入、端口参考时钟输入、全局时钟锁相环（PLL）的设计，以及时钟信号的调制和频率选择。此外，还讨论了时钟信号的电气规格、散布频谱时钟（SSC）的应用和EMI的降低。
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89HPES16T4G2和89HPES12T3G2硬件设计指南
本指南提供了IDT 89HPES16T4G2和89HPES12T3G2 PCIe 2.0交换机设备的系统设计指南。内容涵盖PCI Express接口配置、端口配置、链路宽度、极性反转、AC耦合、差分对路由、参考时钟电路、复位方案、SMBus接口、GPIO和JTAG引脚、电源和去耦方案等。指南旨在帮助系统设计者进行硬件设计，确保设备符合PCI Express规范。
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VersaClock®3S-5P35023评估板用户手册
本资料为VersaClock® 3S - 5P35023评估板用户手册，旨在帮助用户评估IDT公司最新推出的5P35023可编程时序器件。评估板通过USB连接至PC上的IDT Timing Commander软件，可配置和编程以生成不同频率组合。手册详细介绍了评估板的组件、功能、电源选项、默认频率输出、DIP开关配置、I2C端口配置和评估板原理图等内容。
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