Quick Guide - Output Terminations AN-953
发布时间：
2018-08-01
类型：
应用笔记或设计指南，设计参考、应用指南
品牌：
IDT（艾迪悌）
型号：
-
加工定制
提供电机的输出反电势波形测试、驱动芯片输入/输出波形测试服务，帮助您根据具体应用场景来选择适合的电机驱动芯片型号，确保电机驱动芯片能够与其他系统组件协同工作达到最佳效果。支持到场/视频直播测试，资深专家全程指导。
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测试范围：扬兴晶振全系列晶体，通过对晶体回路匹配分析，调整频率、驱动功率和起振能力，解决频偏、不起振、干扰、频率错误等问题。技术专家免费分析，测完如有问题，会进一步晶振烧录/修改电路。
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资料平台
| 数据手册 - 英文 |
4x32Gb/s线性差分驱动器
May 5, 2017
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| 数据手册 - 英文 |
4x32Gb/s线性差分驱动器
May 4, 2017
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缓冲器/时钟驱动器
REV H
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56G–线性PAM4 DML驱动器
January 15, 2018
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1.8V低功耗宽频带时钟驱动器
12/10/09
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1.8V低功耗宽频带时钟驱动器
06/19/07
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28G–1通道DML驱动器
May 10, 2017
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3.3V CMOS缓冲/时钟驱动器
MAY 2010
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3.3V CMOS缓冲/时钟驱动器
2017/11/28
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4x32Gb/s线性MZ调制器驱动器
May 4, 2017
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快速CMOS缓冲/时钟驱动器
MAY 2010
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快速CMOS缓冲/时钟驱动器
MAY 2010
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| 技术文档 - 英文 |
1.8V低功耗宽频带时钟驱动器ICS97U2A845A高级信息
06/30/06
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3.3V CMOS1到2时钟驱动器
MAY 2010
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3.3V CMOS 1到2时钟驱动器
MAY 2010
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3.3V CMOS 1到4时钟驱动器
MAY 2010
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数据表缓冲/时钟驱动器MK3805
REV E
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| 数据手册 - 英文 |
3.3V CMOS 1到10时钟驱动器
JULY 2006
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3.3V CMOS 1到10时钟驱动器
OCTOBER 2014
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| 数据手册 - 英文 |
3.3V CMOS 1到5时钟驱动器
JAN. 2012
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快速CMOS 1到10时钟驱动器
MAY 2010
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| 技术文档 - 英文 |
IO-Link兼容高压线路驱动器（双通道）ZIOL2411功能表
January 28, 2016
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IO-Link兼容高压线路驱动器（单通道）ZIOL2211功能表
April 20, 2016
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双1至8水牛™ 时钟驱动器
REV D
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双1至8水牛™ 时钟驱动器
REV K
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2.5V CMOS 1至10时钟驱动器
MAY 2010
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| 技术文档 - 英文 |
EEPROM可编程2.5V可编程斜交PLL差分时钟驱动器
NOVEMBER 2004
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EEPROM可编程2.5V可编程斜交PLL差分时钟驱动器
2004-11-01
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28G–1通道VCSEL驱动器
November 7, 2017
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技术论坛
400G的PAM4 LR光模块项目，需求一款50Gbps的DML Driver，请帮忙推荐。
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IDT 56Gbps的DML Driver芯片HXT44120和HXT44420的主要区别是什么？
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IDT的56Gbps DML Driver芯片HXT44120相比于HXT44100的最大优势是什么？
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10G SFP+ SR项目，使用的driver是HXT6101，关于diagnostic control register寄存器0x03中的bit7 Iavgsel是什么意思?
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如何通过IDT LVCMOS驱动器或差分驱动器的一侧过驱动晶振接口
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性价比高的USB2.0 redriver芯片推荐。要求比TI的TUSB211性能更好。
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世强AI
世强AI是专注硬创领域的专业垂类AI。基于世强硬创平台沉淀的全品类数据，覆盖 IC、元件、材料、电气、电机、仪器，超千万级 SKU。深度融合全行业原厂技术资料与供应链数据，不仅提供方案设计、器件选型、BOM优化等快速精准的研发支持，更能发起快速购买、样品申请、技术支持、批量询价等服务，贯穿硬件创新全链路，让研发更容易，让采购更便宜。
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应用/方案
1.8V低功耗宽频带时钟驱动器
ICS97U2A845A是一款低功耗、宽范围频率时钟驱动器，适用于DDR2内存模块和零延迟板扇出。该产品提供低偏斜、低抖动的PLL时钟驱动，支持1到5个差分时钟分配（SSTL_18），具有输入到输出同步的反馈引脚，对频谱扩展输入容忍，并在输入信号处于特定逻辑状态时自动PD。该产品采用28球BGA封装，具有高频率稳定性和低抖动特性。
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用IDT保证的斜时钟驱动器简化时钟分配
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细讨论了时钟偏移的来源，包括时钟驱动器和时钟分配系统，并解释了如何通过IDT的IDT49FCT805和IDT49FCT806时钟驱动器来简化最小偏移时钟分配系统的设计。文章还提供了时钟偏移的定义，包括输出偏移、脉冲偏移和组件偏移，并展示了如何使用这些驱动器来满足高速系统的时钟要求。
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用IDT保证的斜时钟驱动器简化时钟分配
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细讨论了时钟偏移的来源，包括时钟驱动器和时钟分布系统，并解释了如何通过IDT的IDT49FCT805和IDT49FCT806时钟驱动器来简化最小偏移时钟分布系统的设计。文章还提供了时钟偏移的定义，包括输出偏移、脉冲偏移和器件间偏移，并展示了这些驱动器如何通过优化电路设计、布局和引脚配置来最小化偏移。最后，文章提供了设计建议，以确保使用IDT49FCT805/806时钟驱动器时实现最佳性能。
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【产品】用于400G / 600G相干应用的新型GX76470线性驱动器
IDT推出了用于光学集成模块的新型GX76470 64G线性驱动器，用于400G / 600G相干应用。线性驱动器GX76470可通过模拟控制/监控引脚和符合OIF标准的SPI数字接口提供各种控制功能，如增益控制和输出电压设置、峰值检测器和增益监控。
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过驱动晶体接口AN-837应用说明
本应用笔记介绍了如何通过LVCMOS驱动器或差分驱动器的一侧通过AC耦合电容来过驱动晶振接口。讨论了XTAL_IN输入的过驱动方法，XTAL_OUT引脚的处理，输入信号的幅度和斜率要求，以及如何配置LVCMOS和LVPECL驱动器的接口电路。此外，还提到了组件布局、数据手册规格的确定以及免责声明。
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时钟分布简化与IDT保证斜时钟驱动器应用说明
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细讨论了时钟偏移的来源，包括时钟驱动器和时钟分布系统，并解释了如何通过IDT的IDT49FCT805和IDT49FCT806时钟驱动器来简化最小偏移时钟分布系统的设计。文章还提供了时钟偏移的定义，包括输出偏移、脉冲偏移和封装偏移，并展示了IDT49FCT805/806如何通过其设计特性来保证低偏移性能。最后，文章提供了设计建议，以确保使用IDT49FCT805/806时钟驱动器时系统能够达到最佳性能和可靠性。
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用IDT保证的倾斜时钟驱动器简化时钟分配应用说明AN-82
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细讨论了时钟偏移的来源，包括时钟驱动器和时钟分布系统，并解释了如何通过IDT的IDT49FCT805和IDT49FCT806时钟驱动器来简化最小偏移时钟分布系统的设计。文章还提供了时钟偏移的定义，包括输出偏移、脉冲偏移和器件间偏移，并展示了如何使用这些驱动器来满足高速系统的时钟要求。
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用IDT保证的倾斜时钟驱动器简化时钟分配应用说明AN-82
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细阐述了时钟偏移的来源，包括时钟驱动器和时钟分配系统，并分析了时钟偏移对系统性能的影响。针对时钟偏移问题，文章重点介绍了IDT49FCT805和IDT49FCT806时钟驱动器，这些驱动器通过优化电路设计、芯片布局和引脚配置，实现了低输出、脉冲和封装偏移。文章还提供了使用IDT49FCT805/806设计最小偏移时钟分配网络的方法和建议，以确保系统性能和可靠性。
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ZSLS7031应用说明-使用反激拓扑的典型LED驱动器应用
本资料为IDT的ZSLS7031 LED驱动器IC的应用笔记，主要介绍了使用Flyback拓扑结构的LED驱动器设计过程。内容包括Flyback变压器的尺寸设计、峰值开关电流和初级电感、漏感及吸收网络、变压器磁芯尺寸设计、辅助绕组设计以及Buck-Boost电感器的设计。资料详细阐述了如何通过计算和设计优化，实现高效、低THD的LED驱动器。
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1200 V SCALE-IDRIVER™栅极驱动器SID1182K
本资料介绍了Power Integrations公司生产的1200 V SCALE-iDriver™门驱动器SID1182K。该产品具有提高可靠性、减小尺寸、降低系统成本的特点，采用eSOP™封装，具备ASSD功能控制去饱和时的di/dt，VEE稳压器避免寄生导通，分输出仅需单极电源供电。适用于工业电机驱动、光伏逆变器、电动汽车充电器等应用，符合VDE 0884-10和IEC 60747-10标准，并经过UL 1577认证。资料还提供了详细的产品参数、设计支持和相关视频、应用笔记等信息。
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NanoDriver全球最小的24W LED驱动器
Seoul Semiconductor推出的NANODRIVER系列是专为LED模块和定制住宅LED驱动器设计的24W LED驱动器。该产品具有极小的尺寸（0.53” x 0.53” x 0.05”），低闪烁，支持AC相切调光或模拟调光，并具备过温保护、超低浪涌电流等功能。产品规格包括输出电压、电流精度、启动时间、输入电压频率、效率、功率因数、浪涌电流、过温保护、隔离和环境温度等。此外，还提供了产品选型表和详细的技术规格说明。
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总线保持应用说明的设计
本文档为应用笔记，主要介绍了总线保持（Bus-hold）技术及其在设计中的应用。总线保持是一种用于保持总线状态的电路，当总线被禁用或没有活动驱动器时，它能够保留总线上的最后活动状态。文章详细阐述了总线保持的优势，包括防止总线浮动、减少元件数量、降低总线负载、减少功耗等。此外，还介绍了总线保持的工作原理、规格、电流水平、保持特性和过驱动特性，并提供了设计指南。
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HiPerClockSTM应用说明高速LVCMOS驱动器终端设计指南
本文档为HiPerClockSTM应用笔记，主要针对高速LVCMOS驱动器端接设计提供指导。内容涵盖高速LVCMOS驱动器端接的一般规则、信号完整性保证以及电磁干扰（EMI）的降低。详细讨论了并行端接、交流端接和串联端接等不同端接方案，并提供了相应的电路图和计算方法。同时，强调了在实际应用中，设计者应与信号完整性工程师合作，并通过仿真验证其设计。
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HiPerClockS公司™ 应用说明高速LVCMOS驱动器终端设计指南
本应用指南针对高速LVCMOS驱动器端接提供设计指导。内容包括并行端接、AC端接和串联端接等不同端接方案，并强调在设计过程中需遵循高速数字板设计规则，以确保信号完整性和电磁干扰（EMI）降低。指南还提供了PC板布局示例，以供选择不同端接方案。
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HiPerClockS公司™应用说明高速LVCMOS驱动器终端设计指南
本文为HiPerClockSTM应用笔记，主要介绍了高速LVCMOS驱动器端接的设计指南。内容包括并行端接、AC端接和串联端接三种方案，并提供了相应的电路图和计算方法。文章强调了正确端接对于确保信号完整性和降低电磁干扰的重要性，并建议设计者在实际应用中根据系统环境进行验证和调整。
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