SYSTEM APPLICATIONS AND DESIGN GUIDELINES WITH IDT’S ZERO-DELAY BUFFERS
发布时间：
2018-08-01
类型：
应用笔记或设计指南，设计参考、应用指南
品牌：
IDT（艾迪悌）
型号：
-
本应用报告详细探讨了使用IDT零延迟缓冲器实现输入参考时钟与输出时钟之间相位关系的方法。报告重点阐述了PLL反馈环路中迹线长度变化及反馈时钟输入处电容负载对产生提前或延迟时钟的具体影响，深入解析了PLL的工作原理与零延迟缓冲器的定义，并提供了通过调整负载和迹线长度来修正相位误差的设计指南。针对文中所述的IDT相关技术方案，IDT在世强硬创平台上由世强先进（深圳）科技股份有限公司授权代理并提供技术支持及采购服务。基于该方案，用户可通过平台获取原厂授权的正品器件，相关产品支持单件起订、在线下单、样品申请、批量询价及充足库存。此外，平台专职FAE团队提供从选型、设计验证到调试的全方位技术支持，覆盖从研发打样到量产的全生命周期采购需求，有助于缩短供应链响应周期，加速产品开发与上市。
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资料平台
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乘法器和零延迟缓冲器
REV G
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乘法器和零延迟缓冲器
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乘法器和零延迟缓冲器
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93722低成本DDR锁相环零延迟缓冲器数据表
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低偏差，1至12 LVCMOS/LVTTL时钟倍增器/零延迟缓冲器
Revision E
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低偏差，1至12 LVCMOS/LVTTL时钟倍增器/零延迟缓冲器
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1.8伏DDR2/800零延迟缓冲器
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低相位噪声零延迟缓冲器
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低偏差，1到12 LVCMOS/LVTTL时钟乘法器/零延迟缓冲器
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DDR I/DDR II锁相环零延迟缓冲器
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低相位噪声零延迟缓冲器及乘法器
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低相位噪声零延迟缓冲器及乘法器
REV J
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低相位噪声零延迟缓冲器及乘法器
REV J
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低相位噪声零延迟缓冲器及乘法器
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双通道DDRII/III零延迟缓冲器
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| 技术文档 - 英文 |
反馈路径对HiPerClockSTM ZDB延迟的影响
Feb 8, 2005
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网络时钟合成器和零延迟缓冲器数据表ICS680-01
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ICS570乘法器和零延迟缓冲器数据表
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低相位噪声零延迟缓冲器ICS571数据表
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乘法器和零延迟缓冲器ICS570数据表
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乘法器和零延迟缓冲器ICS2402数据表
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1.8伏DDR2/800零延迟缓冲器IDT5P61006数据表
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ICS9P935 DDR I/DDR II锁相环零延迟缓冲器数据表
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低成本DDR锁相环零延迟缓冲器ICS93735数据表
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9P960双通道DDRII/III零延迟缓冲器数据表，
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4输出3.3V PCIe零延迟缓冲器9DBL0442/9DBL0452产品介绍
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9DBL0442/9DBL0452 4输出3.3V PCIe零延迟缓冲器数据表
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技术论坛
IDT的零延迟缓冲器2305和2305B有什么区别？
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应用/方案
IDT零延迟缓冲器的系统应用和设计准则
本应用报告介绍了使用IDT零延迟缓冲器实现输入参考时钟与输出时钟之间定义的相位关系的方法。报告重点讨论了在PLL反馈回路中变化迹长和反馈时钟输入处的电容负载对产生提前（或延迟）时钟的影响。提前时钟是指输出时钟的相位相对于参考输入时钟提前的情况。报告还涵盖了PLL的工作原理、零延迟缓冲器的定义以及如何调整零延迟缓冲器的相位误差。
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系统应用和设计指南与IDT的零延迟缓冲器应用说明
本应用报告介绍了使用IDT零延迟缓冲器实现输入参考时钟与输出时钟之间定义的相位关系的方法。报告重点讨论了PLL反馈回路中不同迹线长度和反馈时钟输入处的电容负载对产生提前（或延迟）时钟的影响。提前时钟是指输出时钟的相位相对于参考输入时钟提前的情况。报告还涉及了PLL的工作原理、零延迟缓冲器的定义以及如何调整零延迟缓冲器的相位误差。
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系统应用和设计指南与IDT的零延迟缓冲器应用说明
本应用报告介绍了使用IDT零延迟缓冲器实现输入参考时钟与输出时钟之间定义的相位关系的方法。报告重点讨论了在PLL反馈回路中变化的迹线长度和反馈时钟输入处的电容负载对产生提前（或延迟）时钟的影响。提前时钟是指输出时钟的相位相对于参考输入时钟提前的情况。报告还涉及了PLL的工作原理、零延迟缓冲器的定义以及如何调整零延迟缓冲器的相位误差。
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如何将UFT3G设备设置为零延迟缓冲器（ZDB）
本文介绍了如何将IDT UFT3G零延迟缓冲器（ZDB）设置为具有定义的输入参考时钟与输出时钟之间的相位关系。UFT3G系列包括六种设备，具有与零延迟缓冲器相关的特性。文章详细阐述了ZDB架构，包括如何通过调整外部路径长度来补偿输入和输出时钟之间的偏移，以及如何配置UFT3G设备以实现零延迟缓冲功能。
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零延迟缓冲器
本文介绍了零延迟缓冲器的工作原理和应用，重点介绍了IDT2305、IDT2308和IDT2309三种产品。这些产品均具备高速度、低延迟和低偏移的特点，适用于高速时钟分配和倍频应用。文章详细阐述了这些产品的功能、配置、时序图以及应用实例，并提供了布局建议和电源管理信息。
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零延迟缓冲器
本文介绍了零延迟缓冲器（Zero Delay Buffer）的概念、工作原理和应用。详细阐述了IDT2305、IDT2308和IDT2309三种零延迟缓冲器的特性、功能和应用实例。文章还涉及了零延迟缓冲器的时序图、功耗控制、布局建议等内容。
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AN-872如何将UFT3G设备设置为零延迟缓冲器应用说明
本文档介绍了如何将IDT UFT3G零延迟缓冲器（ZDB）配置为具有定义的输入参考时钟与输出时钟之间的相位关系。UFT3G系列包括六种设备，具有与零延迟缓冲器相关的特性。文档详细说明了ZDB架构，包括如何通过外部路径长度调整来实现输入和输出时钟之间的定义相位关系。此外，还提供了配置UFT3G设备作为ZDB的步骤和注意事项。
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如何将UFT3G设备设置为零延迟缓冲器（ZDB）应用说明AN-872
本文介绍了如何将IDT UFT3G零延迟缓冲器（ZDB）配置为具有定义的输入参考时钟与输出时钟之间的相位关系。UFT3G系列包括六种设备，具有与零延迟缓冲器相关的特性。文章详细说明了ZDB架构，包括如何通过外部反馈路径调整相位，以及如何通过调整外部路径长度来补偿时钟偏移。此外，还提供了配置UFT3G设备作为ZDB的步骤和注意事项。
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零延迟缓冲器应用说明
本文介绍了零延迟缓冲器（Zero Delay Buffer）的工作原理和应用，重点介绍了IDT2305、IDT2308和IDT2309三种器件。这些器件具有高速相锁环（PLL）和低偏移特性，适用于时钟分配和倍频应用。文章详细描述了这些器件的内部结构、功能表、时序图和布局建议，并提供了实际应用案例。
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【产品】可用于PCIe Gen1-5和UPI的4-12输出零延迟/扇出缓冲器9ZXL04/06/08/12x1E
IDT（Renesas收购）推出的9ZXL04x1E / 9ZXL06x1E / 9ZXL08x1E / 9ZXL12x1E系列零延迟/扇出缓冲器（ZDB，FOB）是适用于PCIe和CPU应用的第二代增强性能缓冲器。 该系列符合所有已发布的QPI / UPI，DB2000Q和PCIe Gen1-5抖动规范。
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【产品】15或19输出的缓冲器9ZXL15x0D/9ZXL19x0D/9ZXL1951D，用于PCIe和CPU应用程序
IDT（Renesas收购）推出的9ZXL15x0D/9ZXL19x0D/9ZXL1951D器件，为用于PCIe和CPU应用程序的第二代性能增强型缓冲器系列。 该系列符合已发布的QPI/UPI，DB2000Q和PCIe Gen1-5抖动规范。器件为15或19输出，既可以用作扇出（FOB）缓冲器，又用作零延迟（ZDB）缓冲器。 系列器件均满足DB2000Q和DB1900Z的抖动和偏斜要求。
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【产品】3.3V PCIe零延迟时钟缓冲器9DBL0442 / 9DBL0452，4通道输出，可应用于扩展卡，存储应用
IDT（Renesas收购）推出的9DBL0442 / 9DBL0452缓冲器是IDT全功能PCIe系列的3.3V成员。该器件支持PCIe Gen1-4公共时钟（CC）和PCIe支持独立扩展频谱时钟架构的分离式基准时钟（SRIS）系统。 此外，它提供了集成输出终端的选择，可直接连接到85Ω或100Ω传输线，可以使用用户定义的加电默认SMBus配置对9DBL04P2进行出厂编程。
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零延迟缓冲器应用说明AN-229
本文介绍了零延迟缓冲器（Zero Delay Buffer）的概念、应用以及相关产品。零延迟缓冲器能够将一个时钟信号分配到多个时钟信号，输出之间具有零延迟和非常低的偏斜。文章详细介绍了IDT2305、IDT2308和IDT2309三种产品的特性、功能和应用实例，包括它们的时钟分配、时钟倍增和三态输出等功能。此外，还提供了这些产品的功能表、时序图和布局建议，以确保最佳性能。
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如何将UFT3G设备设置为零延迟缓冲区（ZDB）应用说明
本文介绍了如何将IDT UFT3G零延迟缓冲器（ZDB）设置为具有定义的输入参考时钟与输出时钟之间的相位关系。UFT3G系列包括六种设备，具有与零延迟缓冲器相关的特性。文章详细说明了ZDB架构，包括如何通过调整外部路径长度来补偿输入和输出时钟之间的偏移，以及如何配置UFT3G设备以实现零延迟缓冲功能。
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延迟变化测量与补偿
本文详细介绍了在非理想机架式系统中进行延迟变化测量与补偿的方法。主要内容包括：在非理想系统中，传输时间/相位信息时可能出现的延迟变化问题；如何通过零延迟缓冲器（ZDB）和往返时间（RTT）测量和补偿技术来减少这些延迟变化；以及如何在多卡系统中实现精确的时间同步。文章还讨论了相关设备和技术，如IDT的ClockMatrix系列设备，以及如何使用这些设备来实现高精度的相位调整和测量。
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延迟变化测量和补偿应用说明
本文详细介绍了在非理想机架式系统中进行延迟变化测量和补偿的方法。主要内容包括：非理想系统中延迟变化的预期值、零延迟缓冲器（ZDB）的工作原理、非理想ZDB条件、固定和可变延迟的测量和补偿、将扇出缓冲器引入ZDB环路、往返时间（RTT）测量和补偿、将ZDB和RTT方法扩展到整个系统。文章强调了在5G无线协议和更高版本中，精确的时间/相位信息传输的重要性，并提供了实现这一目标的详细技术指导。
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延迟变化测量和补偿应用说明
本应用笔记主要讨论了在非理想机架式系统中进行延迟变化测量和补偿的方法。内容涵盖了在无线基础设施网络中传输时间/相位信息的重要性，以及如何应对系统中的传播延迟和变化。详细介绍了零延迟缓冲器（ZDB）和往返时间（RTT）测量与补偿技术，并提供了在多卡系统中实现精确时间同步的方案。
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【产品】4路输出 1.8V PCIe 零延迟/扇出时钟缓冲器9DBV0441，输出阻抗为100欧姆
零延迟/扇出时钟缓冲器9DBV0441属于IDT（Renesas收购）的SOC友好型1.8V超低功耗（VLP）PCIe系列。它具有集成的输出终端，其输出阻抗为100Ω可直接连接到100Ω传输线。 该器件具有4个用于时钟管理的输出使能和3个可选的SMBus地址。 9DBV0441具有低功耗、兼容扩频、板空间小等特点。
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【产品】支持PCIe Gen1/2/3的零延迟双通道输出缓冲器9DBV0241
9DBV0241是IDT（Renesas收购）推出的一款零延迟双通道输出PCIe时钟缓冲器，具有2个时钟管理输出和3.3V的容错SMBus接口，可广泛应用于存储，网络，计算机和消费电子中的PCIe 1-3的时钟分配。9DBV0721的终端可直接连接到100Ω传输线，使系统易于集成，相比标准的HCSL输出，可节省8个电阻。
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【产品】2输出3.3V PCIe零延迟缓冲器9DBL0242/9DBL0252
9DBL0242/9DBL0252零延迟缓冲器是IDT（Renesas收购）全功能PCIe系列的3.3V成员。 这些设备支持PCIe Gen1-4公共时钟（CC）和PCIe分离式基准无关型扩频（SRIS）系统。 其集成输出阻抗可以选择，可直接连接到85欧姆或100欧姆传输线。器件可在出厂前采用用户指定的上电默认SMBus配置进行设定。
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IDT时钟缓冲器提供超低的附加相位抖动从计算和多媒体部门的集成设备技术，公司的应用说明
本应用笔记介绍了IDT时钟缓冲器在数字消费和通信应用中的使用，重点在于其超低附加相噪特性。文中详细解释了测量附加相噪的理论，并总结了多个IDT时钟缓冲器的附加相噪结果。此外，还讨论了输入到输出传播延迟和输出到输出偏移等AC参数，并提供了针对零延迟缓冲器的应用笔记链接。测量结果显示，IDT时钟缓冲器在25MHz、100MHz和125MHz频率下的附加相噪极低，适用于各种系统设计。
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CMOS总线开关提供零延迟总线通信应用注释AN-09
Quality Semiconductor公司推出的QS3383和QS3384 CMOS总线开关，是高速TTL总线连接器件。它们能直接连接两个总线，连接电阻小于5Ω，具有零延迟、低噪声、双向传输等特点。这些开关可用于替换传统的TTL缓冲器和收发器，以减少传播延迟、噪声、控制复杂性和功耗。此外，QS3384和QS3383还可用于实现内存交换、交叉开关矩阵、RAM共享等功能。
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