EB-LOGAN-23 18-691-000
发布时间：
2018-08-01
类型：
技术文档，技术说明、产品技术资料
品牌：
IDT（艾迪悌）
型号：
18-691-000
本技术资料详细阐述了EB-LOGAN-23 18-691-000电子设备的系统设计方案。该设计集成了丰富的硬件组件与接口，包括多个中继器连接端口、IO扩展器及热插拔控制端口，并配置了槽复位、唤醒上拉电阻等信号管理机制。在时钟系统方面，资料详细说明了时钟发生器、源输入时钟缓冲器及时钟选择器的应用，并具体列出了覆盖端口0、2、4、6、8、12、16及20的多个时钟发生器配置。此外，该方案还涵盖了电源连接器、电源调节器、复位电路、SMBUS、EEPROM、JTAG接口以及LED指示灯等关键模块，同时明确了最小负载电阻、胶带连接器及分区复位选择头等辅助元件的设计细节，为复杂的电子系统开发提供了全面的参考依据。基于该设计方案，用户可通过世强硬创平台获取相关技术支持与原厂授权的正品器件，平台提供专职FAE团队协助进行选型、设计验证及调试工作。相关产品支持单件起订、在线下单、样品申请及批量询价，并拥有充足库存，能够覆盖从研发打样到量产的全生命周期采购需求，从而有效缩短供应链响应周期，加速产品开发与上市进程。
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资料平台
| 评估板使用说明 - 英文 |
IDT公司™ EB-LOGAN-23评估板手册
February 2011
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| 评估板使用说明 - 英文 |
IDT公司™ EB-LOGAN-23评估板手册
February 16, 2011
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| 技术文档 - 英文 |
EB-LOGAN-23 18-691-001
REV.2.0
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| 评估板使用说明 - 英文 |
IDT公司™ 89EB-LOGAN-19评估板手册
February 16, 2011
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| 技术文档 - 英文 |
EB-LOGAN-19型
REV.1.1
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| 技术文档 - 英文 |
EB-LOGAN-19 18-692-001
REV.2.0
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| 数据手册 - 英文 |
1.25V/1.35V/1.5V通过奇偶校验测试和四芯片选择注册时钟驱动器
2017/11/29
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| 数据手册 - 英文 |
1.25V/1.35V/1.5V通过奇偶校验测试和四芯片选择注册时钟驱动器
2017/11/29
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| 数据手册 - 英文 |
1.35伏/1.5V使用奇偶校验测试和四芯片选择注册时钟驱动程序
2017/11/29
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| 数据手册 - 英文 |
数据表低EMI时钟发生器ICS4231-03
REV C
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| 数据手册 - 英文 |
时钟扇出缓冲器/分频器8V74S4622数据表
REVISION 1
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| 数据手册 - 英文 |
MK2058-01通信时钟抖动衰减器数据表
REV G
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| 数据手册 - 英文 |
8761低电压，低偏斜，PCI/PCI-X时钟发生器数据表
REVISION E
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| 数据手册 - 英文 |
用于PowerPC的ics9341133mhz时钟发生器和集成缓冲器™ 数据表
Rev A
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| 数据手册 - 英文 |
低电压/低偏差，1:8 PCI/PCI-X零延迟时钟发生器
Revision C
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| 数据手册 - 英文 |
MK2069-01基于VCXO的线路卡时钟同步器数据表
REV.K
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低电压/低偏差，1:4 PCI/PCI-X零延迟时钟发生器
REVISION B
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| 数据手册 - 英文 |
低偏差，1至12 LVCMOS/LVTTL时钟倍增器/零延迟缓冲器
Revision E
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低偏差，1至12 LVCMOS/LVTTL时钟倍增器/零延迟缓冲器
Rev A
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低偏斜，1至16 LVCMOS/LVTTL时钟发生器87016I数据表
Rev C
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ICS544-01时钟分频器数据表
REV B
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8T39S04A晶体或差分到差分时钟扇出缓冲器数据表
July 24, 2019
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| 技术文档 - 英文 |
基站射频卡时钟树需要注意的问题
2011年5月
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1到8差分到通用输出时钟分配器/扇形输出缓冲器
REVISION A
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1到8差分到通用输出时钟分配器/扇形输出缓冲器
REVISION A
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低偏斜，1到8差分到LVCMOS/LVTTL时钟发生器
REV. B
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技术论坛
IDT高性能可编程时钟发生器5P35021支持外部晶体输入或者参考时钟输入，那么对参考晶体有什么特别要求吗？
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国产的时钟buffer（单端和差分的）有没有推荐的型号？
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时钟发生器9FGU0631，标准PCIE器件共需要多少个电阻？
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你好，我想了解下1，IDT pcie clock发生器9FGL0841为啥输出频率是8-100MHz？但我需要100M HCSL频点，这个pcie专用时钟芯片还需要I2C寄存器配置频点吗？还是上电默认100M输出的？
2.如果我选用其他通用时钟芯片，带HCSL电平输出的我输出100M，也能用于pcie总线时钟吗
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IDT时钟接收器的共模范围和内部偏置是什么？
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IDT JTAG时钟能否以10MHz以外的频率运行？
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有没有时钟产品，可以输出3路时钟，时钟频率在0-2Ghz之间？抖动没有太大的要求。300fs以内即可。三路时钟最好可以实现任意频点输出。
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有一个PCIE接口的蓝牙模组，以及一个USB3.0，有满足以上差分时钟需求的时钟芯片吗？
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IDT时钟芯片5P35023使用25M输入，能否产生24.576、33M这两个频点，是不是会有频偏？
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目前r car h3开发板上给LVDS,VGA提供外部时钟的时钟发生器芯片主要是哪些型号？
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有没有时钟发生器，能够输出3路时钟一路32.768Khz，一种12mhz，另一个是25mhz的芯片？
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什么控制可编程时钟5T989x/2x VCO的工作频率？
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如果5T982x/5T989x的参考时钟被移除会发生什么?
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IDT VersaClock 5可编程时钟发生器 - 5P49V5901A可以存储多少个器件配置？
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您好，IDT 5PB1104 时钟Buffer 车规级的是否有合适的国产替代，谢谢！
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应用/方案
【应用】IDT车规级可编程时钟发生器5P49V60系列适用于车用激光雷达项目，4路输出满足多路需求
随着科技的发展，经济的繁荣，激光雷达广泛的应用于工业以及汽车市场。由于产品成本原因，不会选择功能较强的MCU内部只有固定一种或两种时钟。所以实际功能只能需求外部提供多种不同的时钟源，本文推荐瑞萨（Renesas）旗下的IDT品牌中的5P49V60系列应用于车用激光雷达项目中。
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【经验】车规级时钟发生器5P49V60输出频偏过大问题的分析
IDT（Renesas收购）的5P49V60是一款支持高达5路差分输出的高性能车规级时钟发生器，最近有工程师在使用5P49V60作为高性能车联网设备时钟源时，碰到了输出时钟精度指标变差的问题。本文将针对该问题进行具体分析。
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【应用】工作频率最高达2GHz的瑞萨时钟芯片8SLVD1204为网络通信处理板提供高速可靠时钟信号
现代的高性能处理器为了适应各种复杂的应用场合，集成了越来越多的功能和接口。比如PCIe，USB3.0，SATA，SGMII等等，随着接口速率的提高，处理器对时钟品质的要求也越来越高。IDT（被Renesas收购）8SLVD1204是一款双输入，四扇出的时钟芯片，工作频率最高达2GHz。本文介绍了它在一款网络通信处理板卡上的设计应用。
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【产品】用于PCIe Gen1-5应用的2和4输出PCIe时钟扇出缓冲器9DBL0255/455，可指示是否有输入时钟
IDT（Renesas收购）推出的9DBL0255/9DBL0455系列是用于PCIe Gen1-5应用的2和4输出PCIe时钟扇出缓冲器。这两部分均具有开漏信号丢失（LOS）输出，用来指示是否有输入时钟。该器件还有一些其他功能，以帮助进行更为可靠的设计。
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【经验】如何为非整数频率配置ClockMatrix时钟器件以获得零转换误差？
IDT（Renesas收购）ClockMatrix时钟器件设计用于支持非整数频率的精确转换。在10GB以太网LAN/WAN传输中，前向纠错(FEC)应用经常需要用一个基频乘以比率来表示时钟速率。问题是，一些比率例如OTU1 (255/238*2,488.320kHz)，会导致非常长的小数，这些小数经常会被截断。本文讨论如何为非整数频率配置ClockMatrix器件，以获得零转换误差。
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【产品】可对输出时钟频率进行调制的系统时钟发生器6P41505，工业温度范围-40°~85°C
IDT（Renesas收购）推出的6P41505是一款系统时钟发生器，用于高性能消费者、网络、工业、计算以及数据通信应用。6P41505的频率是由单个参考时钟或晶体生成。 为了帮助减少电磁干扰（EMI），6P41505具备优秀的扩频调制性能。可以对输出时钟频率进行调制，以将能量分散到更宽的频率范围内，从而降低系统EMI。6P41505使用小数N分频实现扩频，以实现可控的调制速率和扩频幅度。
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时钟分布简化与IDT保证斜时钟驱动器应用说明
本文介绍了时钟偏移问题及其在高速系统设计中的重要性。文章详细讨论了时钟偏移的来源，包括时钟驱动器和时钟分布系统，并解释了如何通过IDT的IDT49FCT805和IDT49FCT806时钟驱动器来简化最小偏移时钟分布系统的设计。文章还提供了时钟偏移的定义，包括输出偏移、脉冲偏移和封装偏移，并展示了IDT49FCT805/806如何通过其设计特性来保证低偏移性能。最后，文章提供了设计建议，以确保使用IDT49FCT805/806时钟驱动器时系统能够达到最佳性能和可靠性。
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【产品】瑞萨VersaClock®5P49V60系列可编程时钟芯片，助力轻松实现复杂的汽车系统时钟设计
瑞萨推荐最新的VersaClock®5P49V60系列可编程时钟芯片。供电电压支持1.8V/2.5/3.3V可选，在3.3V输入情况下最高功耗低于100mW。满足AEC-Q100 Grade2标准，可以在-40~105℃温度范围内输出时钟频率0.001M~350MHz，并保证0.5ps以内卓越的抖动性能。5P49V60的抖动/成本性价比更高，4*4mm的QFN封装，PCB占板面积更低。
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【经验】高性能时钟扇出缓冲器8T39204 3.3V差分时钟输入接口参考设计
IDT（被Renesas收购）推出了一些高性能时钟扇出缓冲器，以8T39204为例。 输入时钟可以从两个差分输入或一个晶体输入中选择。 如果未选择晶振输入，则内部振荡器电路将自动禁用。 晶体引脚可以由单端时钟驱动。 所选信号分配到四个差分输出，可以配置为LVPECL，LVDS或HSCL输出。 此外，还提供了LVCMOS输出。 本文分享几种针对常见的驱动器的3.3V差分时钟输入接口参考设计。
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