在 Altera MAX 系列中实现交叉点开关矩阵
发布时间：
2018-09-29
类型：
技术文档，技术说明、产品技术资料
品牌：
Altera（阿尔特拉）
型号：
MAX® 3000A; MAX II; MAX V; MAX 10; 10M08SAE144C8GES; EPM570F256C3; EPM3256ATC144; EPM240T100C3; EPM3064ATC100; MAX 3000A
本技术文档详细介绍了在Altera MAX系列器件中实现交叉点开关矩阵的方法，重点阐述了16x16交叉点开关的体系结构、配置过程及扩展方法。文档内容涵盖了使用Quartus II软件进行设计、验证和资源利用率分析的完整流程，并提供了针对MAX 10、MAX II和MAX 3000A器件的参考设计文件及设计利用率表，旨在帮助工程师高效完成相关逻辑设计。Altera在世强硬创平台上由世强先进（深圳）科技股份有限公司授权代理并提供技术支持及采购服务。基于该方案，用户可通过平台获取原厂授权的正品器件，相关产品支持单件起订、在线下单、样品申请及批量询价，且库存充足。平台专职FAE团队提供从选型、设计验证到调试的全流程技术支持，覆盖从研发打样到量产的全生命周期采购需求，有助于缩短供应链响应周期，加速产品开发与上市。
资料下载
资料平台
| 数据手册 - 英文 |
MAX 3000A可编程逻辑器件系列
ver. 3.5
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| 测试报告 - 英文 |
可靠性报告2016年下半年
2017/11/14
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| 产品变更通知及停产信息 - 英文 |
客户咨询ADV0306在MAX 3000A设备上引入双重标记
05/30/03
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| 产品勘误说明 - 英文 |
最大7000AE、最大7000B和最大3000A设备
ver. 2.0
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| 技术文档 - 中文 |
使用 Altera MAX 系列作为微控制器 I/O 扩展器
版本 2014.09.22
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| 数据手册 - 英文 |
第一部分：MAX II器件系列数据表
version 1.6
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| 测试报告 - 英文 |
可靠性报告57 2014年上半年
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
客户咨询ADV1509 Altera®MAX®10 FPGA产品系列订购信息更新
Revision: 1.0.0
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| 产品勘误说明 - 英文 |
MAX II设备系列
ver. 1.3
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| 技术文档 - 中文 |
在 Altera MAX 系列中实现 LED 驱动器
版本 2014.09.22
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| 数据手册 - 英文 |
MAX II开发板
version 1.1
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| 测试报告 - 英文 |
可靠性报告2017年上半年
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
进程更改通知MAX 3000A设备进程转换
11/10/00
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| 产品勘误说明 - 英文 |
最多10个设备勘误表
version 2016.05.16
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| 数据手册 - 英文 |
4MAX II设备中的热插口和上电复位
version 2.1
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| 测试报告 - 英文 |
可靠性报告59 2015年上半年
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
客户咨询ADV0202 MAX7000AE和MAX3000A流程转换更新
2/1/02
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| 产品勘误说明 - 英文 |
最大10 ES设备的勘误表和指南
version 2015.06.12
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| 数据手册 - 英文 |
BitBlaster串行下载电缆
Version 4.3
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| 测试报告 - 英文 |
可靠性报告58 2H 2014
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
工艺变更通知PCN1106 ALTERA倒装芯片和WIREBOND BGA封装的额外材料清单和供应商
Revision: 1.2.0
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| 数据手册 - 英文 |
英特尔®MAX 10 FPGA器件数据表
Version
2017.06.16
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| 测试报告 - 英文 |
可靠性报告60 2H 2015
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
客户咨询ADV0907 MBGA包装的附加装配厂
Revision: 1.0.0
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| 技术文档 - 中文 |
在 Altera MAX 系列中实现串行外设接口主器件
版本 2014.09.22
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| 数据手册 - 中文 |
MAX 10 FPGA 器件数据表
版本 2015.05.04
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| 测试报告 - 英文 |
可靠性报告53 2012年第2季度
2019/01/03
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| 产品变更通知及停产信息 - 英文 |
工艺变更通知PCN1312 MAX®II Z产品的额外铸造来源
Revision: 1.1.0
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| 数据手册 - 英文 |
最大10 FPGA设备数据表
Version 2015.06.12
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| 产品变更通知及停产信息 - 英文 |
工艺变更通知PCN0808所选TQFP封装线键直径减小
Revision: 1.0.0
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| 技术文档 - 中文 |
在 Altera MAX 系列中使用用户闪存更换串行 EEPROM
版本 2014.09.22
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| 数据手册 - 英文 |
Altera编程硬件
ver. 5.3
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| 产品变更通知及停产信息 - 英文 |
客户咨询ADV1104 MAX II/G和MAX II Z设备的附加铸造源资格
Revision: 1.2.0
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| 数据手册 - 英文 |
MAX+PLUSⅡ可编程逻辑开发系统及软件数据表
ver. 8
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| 产品变更通知及停产信息 - 英文 |
工艺变更通知PCN0712 BGA、UBGA、MBGA和FBGA包的模具化合物变更
Revision: 1.0.1
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世强AI
世强AI是专注硬创领域的专业垂类AI。基于世强硬创平台沉淀的全品类数据，覆盖 IC、元件、材料、电气、电机、仪器，超千万级 SKU。深度融合全行业原厂技术资料与供应链数据，不仅提供方案设计、器件选型、BOM优化等快速精准的研发支持，更能发起快速购买、样品申请、技术支持、批量询价等服务，贯穿硬件创新全链路，让研发更容易，让采购更便宜。
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应用/方案
10 步了解英特尔MAX 10 FPGA 设计：入门指南
本指南旨在帮助用户快速了解英特尔 MAX 10 FPGA 设计。内容涵盖 MAX 10 FPGA 的定义、产品家族概述、开发与测试硬件、文档资源、注册流程、设计工具、许可证、教程、设计示例和支持服务。指南旨在为初学者提供入门级指导，帮助他们开始使用 MAX 10 FPGA 进行设计。
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MAX 10 FPGA器件概述
MAX 10 FPGA器件是业界首款单芯片非易失性可编程逻辑器件，集成了系统组件，具有自配置双映像、设计保护、集成ADC和Nios II微控制器IP。特点包括简单快速配置、灵活性和集成性、低功耗、20年使用寿命。器件支持多种设计工具，包括Quartus II、Qsys、DSP Builder和Nios II EDS。特性包括55 nm工艺技术、多种封装、核心体系结构、内部储存器模块、用户闪存、嵌入式硬核IP、ADC、闪存IP、时钟网络、内部振荡器、PLL、通用I/O、外部存储器接口和配置选项。
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带Altera MAX系列的NAND闪存接口
本文档介绍了如何使用Altera MAX II、MAX V或MAX 10器件实现NAND闪存接口。该设计支持三星和AMD NAND闪存。文档详细描述了接口信号、操作流程、支持的AMD和三星NAND闪存设备命令，以及设计示例和源代码。
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使用Altera MAX系列复用SDIO设备
本文介绍了使用Altera MAX II、MAX V和MAX 10器件实现SD或SDIO设备多路复用器的功能。该设计示例展示了如何通过I2C接口控制多路复用器的选择线，以实现多个SD/SDIO设备与单个SD/SDIO主机的连接。文章还提供了MAX II和MAX 10的设计文件和相关应用信息。
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使用Max10的NiosⅡ闪光加速器
本文介绍了Nios II闪存加速器，旨在提高Nios II/f“快速”核心在实时应用中的性能。该加速器通过Max 10设备直接从用户闪存或集成在Max 10芯片上的闪存执行指令。闪存加速器利用等待状态进行预取，以提高从高延迟内存（如闪存）运行时的指令执行速度。该加速器支持小缓存，适用于不需要任何内存块的Nios II系统。文章详细描述了缓存操作、预取和地址生成等模块的功能和性能。
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采用Intel MAX 10的OSCAR网络兼容工业设备平台
OSCAR平台是一款针对物联网时代网络设备的平台，基于Intel MAX 10 FPGA。平台支持单芯片定制CPU，可使用Nios II，并具备足够的容量和配置ROM。支持外部SDRAM和QSPI闪存，可根据软件应用大小进行扩展。平台集成两个10/100 PHY，可轻松实现网络设备。此外，平台还提供了EtherCAT硬件主控制器，支持BECKHOFF EtherCAT从IP，适用于现有CPU板的改造。
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了解HDL语言和FPGA与这个低成本的最大10 FPGA板
本资料介绍了Enterpoint公司推出的低成本MAX 10 FPGA开发板——Polmaddie6，旨在帮助工程师学习和使用HDL语言设计FPGA电路。该开发板包含Altera MAX 10 FPGA、功率调节器、ADC等组件，并支持多种编程接口。资料还提供了软件下载链接、技术规格、订购信息以及Enterpoint和Altera的联系方式。
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Nios II性能基准
本资料详细介绍了Nios® II软处理器的性能基准和逻辑单元（LE）使用情况。资料中比较了Nios II/f和Nios II/e两种处理器核心的性能，并提供了在不同FPGA设备上的逻辑大小、频率和DMIPS（Dhrystone百万指令每秒）等性能指标。此外，还包括了资源利用率、文档修订历史和相关链接等信息。
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在Altera MAX系列中实现LED驱动程序
本文介绍了如何在Altera MAX系列器件中实现LED驱动器。文章详细阐述了使用Altera MAX II、MAX V、MAX 10、MAX 3000A、MAX 7000A、MAX 7000B和MAX 7000S器件作为LED驱动器芯片的方法，包括LED驱动器芯片的选择、电路设计、资源利用和设计验证等关键步骤。文章还提供了相关的设计示例和资源链接，以帮助读者更好地理解和应用。
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在 Altera MAX 系列中使用用户闪存更换串行 EEPROM
本文档介绍了在Altera MAX系列器件中使用用户闪存（UFM）模块替换串行EEPROM的方法。内容包括UFM模块的容量、逻辑阵列接口、擦除和重新编程序列、支持的IP内核以及与串行EEPROM的差异。此外，还提供了相关器件的供应商信息以及文档修订历史。
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汽车为生产力铺平道路
该资料主要介绍了Altera公司针对汽车行业的可编程逻辑器件（PLD）解决方案，包括MAX® CPLDs、Cyclone® 和MAX 10系列FPGAs和SoCs。资料强调了Altera产品在汽车电子领域的优势，如可扩展性、灵活性和高性能，以及其在安全性和可靠性方面的承诺。此外，还介绍了Altera在汽车信息娱乐、高级驾驶辅助系统（ADAS）、电动汽车和动力总成等领域的应用案例，以及其功能安全解决方案和开发工具。
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Intel MAX 10 FPGA设计的10个步骤：入门指南
本资料为Intel MAX 10 FPGA设计入门指南，分为十个步骤。内容包括介绍MAX 10 FPGA的特点和应用，提供产品表格、开发板、文档资源，指导用户注册账户、下载设计软件，并提供教程、设计示例和技术支持。
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最大10 FPGA器件系列引脚连接指南PCG-01018
本资料为MAX 10 FPGA器件家族的引脚连接指南，详细介绍了MAX 10 FPGA的引脚连接规范，包括时钟和PLL引脚、配置/JTAG引脚、差分I/O引脚、外部存储器接口引脚、参考引脚、电压传感器引脚、MAX 10S（单电源）FPGA和MAX 10D（双电源）FPGA等。指南提供了引脚功能描述、连接指南和注意事项，旨在帮助用户正确连接MAX 10 FPGA引脚，确保设备正常运行。
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14通过嵌入式处理器为ISP使用Jam-STAPL
本文介绍了使用Jam STAPL语言通过嵌入式处理器进行In-System Programming (ISP)的方法。内容涵盖嵌入式系统设计、JTAG链路连接、软件开发、Jam文件生成和配置、Jam Player的使用以及内存使用估算等方面。文章详细阐述了如何通过Jam STAPL在嵌入式系统中实现PLD的编程和配置，包括连接JTAG链路、软件开发流程、Jam文件类型、生成和编译、以及如何在嵌入式环境中使用Jam Player进行编程和验证。此外，还提供了关于内存使用估算的指导，包括ROM和RAM的使用。
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使用AlteraCPLD中的用户闪存替代串行EEPROM存储器件
本资料介绍了如何使用Altera MAX II和MAX V器件系列中的用户闪存（UFM）模块来替代串行EEPROM存储器件。UFM模块可以存储配置数据和ID信息，支持多种接口协议，并具有扇区擦除和编程功能。资料详细说明了设计考量、擦除和重编程顺序、存储容量和操作条件，并提供了一些可能被UFM模块取代的串行EEPROM存储器件的供应商列表。
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