Silicon Labs（芯科科技） Si5324 数据手册
Si5324是一种低带宽、抖动衰减、精度高的时钟倍增器，适用于环路带宽在4-525赫兹之间、要求低于1ps抖动性能的应用。SI5324接受2 kHz至710 MHz范围内的两个输入时钟，并生成2 kHz至945 MHz范围内的两个输出时钟，并选择频率至1.4 GHz。这两个输出与一个公共源分开。Si5324还可以使用其外部参考作为频率合成的时钟源。该设备在整个工作范围内提供几乎所有的频率转换组合。SI5324输入时钟频率和时钟倍增比可通过L2C或SPI接口进行编程。Si5324基于Silicon Laboratories的第三代DSPLL®技术，该技术在高度集成的PLL解决方案中提供任何频率合成和抖动衰减，消除了对外部VCXO和滤波器组件的需求。DSPLL环路带宽是数字可编程的，在应用程序级别提供抖动性能优化。Si5324非常适合在高性能定时应用中提供时钟倍增和抖动衰减。
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