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- 139*****302_世强 (0)
Si5346的锁相环锁定时间和输入信号的质量有较大关系，在外部输入时钟固定的情况下，一般可以通过增加FAST LOCK带宽和减少LOL判决门限的方法减少锁定时间，Si5346的锁定时间一般在600ms以内，不能定量设计锁定时间。
- 创建于2016-06-20
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DUAL PLL Jitter Attenuator Baseblank prototyping device: DUAL PLL Jitter Attenuator: 4-outputs up to 350 MHz 最小包装量：1,000 |
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