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- 139*****302_世强 (0)
- 锁相环环路带宽的设置会影响锁相环的锁定速度，设置最大环路带宽4KHz，也会减少锁相环的锁定时间和对输入时钟信号噪声抑制能力。时钟芯片Si5347在最大带宽下对输入信号的去抖动能力会减弱，会在一定条件下影响通信业务的稳定性。
- 创建于2015-12-21
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jitter attenuator SI5347D-D;SI5347;SI5347D系列 Low-jitter, quad DSPLL, 4-output, any frequency (< 350MHz), any output jitter attenuator; 64-Lead QFN 最小包装量：1,000 |
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Clock Multiplier SI5347;SI5347A;SI5347A-D系列 8-Output Quad DSPLL Any-Frequency Jitter Attenuating Clock Multiplier 最小包装量：260 |
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Clock Multiplier SI5347A系列 8-Output Quad DSPLL Any-Frequency Jitter Attenuating Clock Multiplier 最小包装量：1,000 |
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DUAL PLL Jitter Attenuator SI5347A系列 DUAL PLL Jitter Attenuator 最小包装量：1,000 |
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jitter attenuator SI5347D-D;SI5347;SI5347D系列 Low-jitter, quad DSPLL, 4-output, any frequency (< 350MHz), any output jitter attenuator; 64-Lead QFN 最小包装量：260 |
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DUAL PLL Jitter Attenuator SI5347B系列 DUAL PLL Jitter Attenuator; 最小包装量：260 |
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DUAL PLL Jitter Attenuator SI5347C系列 DUAL PLL Jitter Attenuator; 最小包装量：260 |
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