• 抖动衰减器Si5346B-B-GM芯片的DSPLLA和DSPLLB都在频率计划中进行了配置,实测中发现在IN0和IN2之间进行时钟切换,输入输出不正常,请问这是什么原因?

  • 抖动衰减器Si5346B-B-GM芯片的DSPLLA和DSPLLB的都在频率计划中进行了配置,其中DSPLLA对应输入IN0,输出OUT0和OUT1。DSPLLB对应输入IN2,对应输出OUT2和OUT3,实测中发现在IN0和IN2之间进行时钟切换,当IN0有输入,IN2无输入时,发现OUT2和OUT3仍然存在输出,请问这是什么原因?

  • 创建于2016-06-06

1个回答

  • 139*****302_世强 (0)

    这个问题可以通过修改内部寄存器解决。将0x142的bit0和bit1全部初始值配置成0x0,即在失锁时使得输出端全部Disable,即可解决。

    创建于2016-06-06

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