【产品】R-Car H3 时钟发生模块介绍

2019-11-08 Renesas

R-Car H3Renesas第三代R-Car汽车自动驾驶平台解决方案,64位ARM架构体系,八核处理器,四个Cortex-A57,四个Cortex-A53,还有一个用于实时处理的双锁步Cortex-R7内核,以及 PowerVR Series6XT GX6650 3D图像加速引擎,频率600MHZ。 本文主要针对R-Car H3的时钟发生模块进行介绍。



R-Car H3的所有模块都是有相关的时钟作为数据收发的时序,内部框图如下:

    

内部共有5路PLL电路,以及CPU的时钟分频,以及给通用外设使用的分频器,从而满足整个R-Car H3平台系统的时钟树系统,并且这个时钟树满足功能安全。


目前R-Car H3的参考设计一般是16.66MHZ的外部晶体,配合上下2图的PLL流程图,以及对应的倍频关系可以简单分析一下:

比如通过PLL0的180倍的倍频后输出3GHZ,再通过1/2分频产生1.5GHZ给A57核使用,最高可以到1.7GHZ。

比如同样的PLL2倍频144倍到2.4GHZ,再1/2分频给A53核使用。

比如系统中SCIF串口模块的时钟的PCK采用S3D4ϕ,SCKi采用的S3D1ϕ时钟。


通过以上对CPG(时钟发生模块)的介绍,相信各位读者已经基本搞清楚系统内部时钟树的产生关系以及原理,搞清楚R-Car H3的内核各种模块的关键部件--时钟的对应关系了。在做启动代码的时钟修改和内核的驱动中时钟的修改时都需要找准对应的时钟,才能正确设置各种外设模块(SCIF,USB,SPI,DU等模块)的时钟,以及其他相关寄存器,因此请务必注意。


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